12V DC-5V DC 변환기


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나는 인터넷에서이 회로를 얻었다. 왜이 회로에 커패시터가 설치되어 있는지 모르겠습니다. 누군가이 커패시터의 이유를 말해 줄 수 있습니까?

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실제 보드에 가능한 한 가깝게 배치되어야하기 때문에 도면에 레귤레이터 근처에 C3이 있어야한다고 생각합니다.
0x6d64

@ 0x6d64-예, 회로도에서 C2와 C3도 교체합니다.
stevenvh 2016 년

출력시 C2 / 100 uF가 모든 데이터 시트에 표시되지는 않습니다. 많은 경우에 선택 사항이며, 레귤레이터가 통과 할 수있는 것보다 더 큰 피크 전류를 허용합니다. 어떤 이유로 든 C2가 임시 Vout 소스를 제공하는 경우 "레귤레이터가"삭제 "됩니다. 하지만 짧은 빈 또는 V1을 제거하고 C2는 V1 다른 무거운 하중이있는 경우 수도 다시 전류 흐름과 U1 파괴는. 100 uF는이를 수행하기에 충분히 크지 않을 수 있습니다. Vin에서 Vout으로 U1의 역 다이오드는이 문제를 방지합니다.
Russell McMahon

답변:


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suha 는 전압을 안정화한다고하지만 C3은 실제로 레귤레이터의 제어 루프 를 안정화하기위한 것 입니다. 커패시터가 아닌 안정적인 출력 전압을 일으키는 제어 루프입니다. 대부분의 레귤레이터, 특히 LDO는 진동을 방지하기 위해 C3이 필요합니다. ESR (등가 직렬 저항)이 중요합니다.

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이 문서 의 그래프 는 주어진 레귤레이터에 대해 1Ω의 ESR을 갖는 커패시터가 필요하다는 것을 보여줍니다. 이 문서는 150mA 부하에서 너무 낮은 ESR 커패시터로 발진이 발생하는 방식을 보여줍니다.

레귤레이터의 제어 루프는 특정 응답 시간을 가지므로 갑작스런 부하 변화로 인해 레귤레이터가 반응하기 전에 출력 전압이 약간 떨어질 수 있습니다. C2는 이러한 빠른 변화를 포착하기위한 버퍼 역할을합니다.

μμ


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Steven은 C3의 목적을 설명했지만이 회로에는 입력 측에 해당하는 회로가 없습니다. 문제는 C1과 C2가 고속 응답이 불량하고 일부 ESR (등가 직렬 저항)이있는 대형 캡이라는 것입니다. 이는 대량 저장에는 적합하지만 갑작스러운 전류 서지를 제공하기에는 적합하지 않습니다. 시간 영역에서 "sudden"은 주파수 영역에서 "high frequency"와 동일합니다.

78L05는 높은 ESR 입력 캡으로 안정적 일 수 있지만 일반적으로 좋은 생각은 아닙니다. 대부분의 데이터 시트는 낮은 ESR 캡을 물리적으로 레귤레이터의 입력 및 출력에 가깝게 배치하도록 권장합니다. 세라믹 캡은 기준을 잘 충족하지만 전해 캡처럼 큰 크기는 아닙니다. 그렇기 때문에이 회로의 C2 및 C3과 같이 큰 편광 캡이 훨씬 작은 캡과 병렬로 나타나는 경우가 있습니다.

오늘날, 100nF는 78L05와 같은 낮은 ESR 캡에 바보입니다. 오래 전에는 더 많은 비용을 들이지 않고도 얻을 수있는 가장 큰 세라믹 캡이었습니다. 현재 저전압에서 1 µF 및 심지어 10 µF도 쉽게 구입할 수 있으며 합리적인 비용입니다. 레귤레이터의 입력 및 출력 모두에 1µF 세라믹을 배치하고 레귤레이터 핀에 짧고 직접적인 트레이스로 가능한 한 물리적으로 가깝게 배치했습니다.

100 nF는 여전히 1 µF보다 약간 더 나은 주파수 응답을 갖지만, 오늘날의 1 µF조차도 20 년 전에이 회로가 설계된 100 nF보다 우수합니다. 100 MHz 이상이되면 이러한 것들을주의 깊게 살펴 봐야합니다. 예를 들어, RF 애플리케이션에서 100pF 캡의 특정 모델을 한 번 사용했습니다. 다양한 캡의 RF 주파수에서 가장 낮은 유효 임피던스를 가지기 때문입니다. 그러나 이것은 특수 문제입니다. 78L05 레귤레이터와 같은 제품의 경우 1µF 세라믹 만 사용하면됩니다.


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노이즈를 필터링하고 전압을 안정화하는 데 사용됩니다. C1은 입력을 필터링하고 C2와 C3은 안정성과 과도 응답을 향상시킵니다.

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