필요에 따라 "다시 배선"할 수있는 FPGA가 있습니까?


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예를 들어, 부동 소수점 연산이 많은 경우 부동 소수점 명령어를 처리하기 위해 일부 정수 단위의 영역을 "재 와이어"할 수 있으며 그 반대도 마찬가지입니다. 또는 계산이 많지 않지만 I / O가 필요한 경우 IO를 더 잘 병렬화 할 수 있습니다.

아시다시피, FPGA는 부팅시 HDL 코드를로드하지만 필요에 따라 더 큰 HDL의 다른 부분을 부분적으로 다시로드 할 수있게하는 것은 실제로 불가능하지 않습니다.

그러한 FPGA가 이미 존재합니까?

답변:


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