«flipflop» 태그된 질문

플립 플롭 또는 래치는 두 가지 안정적인 상태를 가진 회로이며 상태 정보를 저장하는 데 사용할 수 있습니다.

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래치와 플립 플롭의 차이점은 무엇입니까?
래치와 플립 플롭의 차이점은 무엇입니까? 내가 생각하고있는 것은 래치가 비트를 저장하는 데 사용되며 데이터를 저장하는 데 사용되는 레지스터와도 같기 때문에 플립 플롭과 같습니다. 그러나 인터넷에서 기사를 읽은 후 에지 트리거 및 레벨 감지 기능을 기반으로 래치와 플립 플롭의 차이점을 발견 했습니까? 그게 무슨 뜻이야? 플립 플롭이 래치와 동일합니까?
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상태 저장 요소의 출력이 종종 Q로 명명되는 이유는 무엇입니까?
논리 회로도에서 논리 게이트 및 조합 회로의 입력 및 출력 이름 지정에 대한 다양한 규칙을 보았습니다. 그러나, 래치와 같은 상태 요소 플립 - 플롭 자주 추상적와의 연결이 의심 Q.라고 자신의 "상태"가 유한 상태 기계 "상태"가 종종 아니라 Q를 알 수있다 이론적 컴퓨터 과학에서 (나는 이렇게 물었다 그들도 :-) 그런데 왜 …
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플립 플롭이란?
플립 플롭과 래치에 대해 여러 가지 다른 정의가있는 것 같습니다. 그 중 일부는 모순됩니다. 내가 가르치는 과정에 대한 컴퓨터 과학 교과서는 아마도 가장 혼란 스러울 것입니다. 나는 적어도 논리 게이트 및 타이밍 다이어그램 측면에서 래치 (SR, 게이트 SR, 게이트 D)의 작동과 레벨 트리거 및 에지 트리거 장치의 차이점에 익숙합니다. 그러나 …
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시리얼 프로토콜 구분 / 동기화 기술
오늘날에도 비동기식 직렬 통신이 전자 장치에 널리 보급됨에 따라 많은 사람들이 때때로 이러한 질문에 직면했다고 생각합니다. 직렬 회선 (RS-232 또는 이와 유사한)으로 연결된 전자 장치 D와 컴퓨터를 고려하여 PC정보를 지속적으로 교환해야합니다 . 즉 , PC각 명령 프레임을 보내고 상태 보고서 / 원격 측정 프레임으로 각각 응답합니다 (보고서는 요청에 대한 응답으로 …
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두 가지를 모두 지원하는 FPGA에서 플립 플롭보다 래치를 더 잘 사용하는 경우는 언제입니까?
질문: 두 가지를 모두 지원하는 FPGA에서 플립 플롭보다 래치를 더 잘 사용하는 경우는 언제입니까? 배경: FPGA에서는 레벨 감지 투명 래치를 피하고 에지 감지 플립 플롭 만 사용해야한다는 것은 잘 알려진 원칙입니다. 대부분의 FPGA 아키텍처는 기본적으로 래치와 플립 플롭을 모두 지원합니다. FPGA 벤더의 경우에도 일반적인 조언은 래치를 조심하거나 래치를 사용하지 않는 …
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왜 플립 플롭을 클록합니까?
플립 플롭 및 래치를 이해하려고합니다. Morris Mano의 Digital Logic 책을 읽고 있습니다. 내가 이해할 수없는 한 가지는 플립 플롭을 클록하는 이유입니다. 왜 '활성화'또는 게이트 래치가 필요한지 이해합니다. 그러나 시계 사용은 무엇입니까? 나는 이것을 이해할 수 없다. 필요한 플립 플롭을 활성화하고 입력 할 수없는 이유는 무엇입니까? 입력을 변경하면 출력이 변경됩니다. 클럭 …
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순간적인 스위치 제어 토글 만들기
순간 스위치가 2- 상태 토글 출력 (래칭 순간 스위치)을 생성하도록하는 가장 간단하고, 저렴하며, 가장 작은 방법은 무엇입니까? 다시 말해, 출력은 지속적으로 낮으며, 버튼 / 택트 스위치를 잠깐 누르면 출력이 지속적으로 높아지고 다시 누르면 다시 낮게 전환됩니다.
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계단식 D- 플립 플롭은 왜 전이성을 방지합니까?
나는 metastability가 무엇인지 이해하지만 플립 플롭을 연결하는 것이 어떻게 이것을 감소시키는 지 이해하지 못합니까? 첫 번째 플립 플롭의 출력이 준 안정 가능하면 두 번째 플립 플롭의 입력으로 사용됩니다. 그러나 두 번째 플립 플롭 이이 입력으로 무엇을 할 수 있고 안정적으로 만들 수 있는지 알 수 없습니다. 미리 감사드립니다!
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SR 래치를 이해하는 방법
SR 래치가 어떻게 작동하는지 머리를 감쌀 수 없습니다. 겉보기에는 R의 입력 라인과 S의 입력 라인을 연결하면 Q와 Q '의 결과를 얻을 수 있습니다. 그러나 R과 S 모두 상대방의 출력에서 ​​입력이 필요하고 상대방의 출력에서 ​​상대방의 출력에서 ​​입력이 필요합니다. 닭고기 나 계란이 먼저 나오는 이유는 무엇입니까? 이 회로를 처음 연결하면 어떻게 시작됩니까?
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SR 래치에서 Q의 시작 상태는 무엇입니까?
이 다이어그램에서 Q의 시작 상태는 무엇입니까? S와 R에 대한 첫 번째 NOR가 이전 결과에 의존하기 때문에 첫 번째 반복에 무언가가 있어야합니까? 참고 : 나는 첫해 디지털 로직 클래스에 있기 때문에 문제는 실제 구현이 아니라 이론적 용도 (테이블 만들기, 적용되는 다양한 숙제 문제 등)입니다. "R이 __이고 S가 __ 인 경우 Q …
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RS 플립 플롭에서 S = 1, R = 1 상태가 금지 된 이유는 무엇입니까?
나는 RS 플립 플롭을 발견했으며 시뮬레이터에서 구현하고 실제 논리 게이트를 사용해 보았습니다. 그러나 플립 플롭에서 불안정하거나 금지 된 경우 S = 1, R = 1을 올바르게 이해했는지 확실하지 않습니다. 누구든지 정확히 무엇인지 말해 줄 수 있습니까? 그건 그렇고 나는 플립 플롭을 구현하기 위해 2 입력 NAND 게이트를 사용했습니다. NAND 게이트 …
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위반시 셋업 및 홀드 타임 출력
설정 시간이 20ns이고 유지 시간이 0ns 인 입력 신호 X를 갖는 포지티브 에지 트리거 D 플립 플롭을 고려하십시오. 출력은 무엇입니까? C는 40ns의주기를 갖는 클록 신호이다. 6 번째 포지티브 에지 동안 데이터 (또는 X)가 1에서 0으로 이동하기 전에 20ns (설정 시간) 동안 안정적이지 않다는 것을 알 수 있습니다. 따라서 출력을 예측할 …
9 clock  flipflop  setup 
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