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VHDL 또는 Verilog? [닫은]
VHDL 과 Verilog 는 오늘의 HDL입니다. HDL에 대해 전혀 경험이없는 사람에게는 어떤 장점이 있습니까?
Verilog는 전자 시스템을 모델링하는 데 사용되는 하드웨어 설명 언어 (HDL)입니다. 디지털 로직 칩의 설계, 검증 및 구현에 가장 일반적으로 사용됩니다. 해당되는 경우 [fpga], [asic] 또는 [verification]으로 태그하십시오. 많은 Verilog 질문에 대한 답변은 대상별로 다릅니다.